quarta-feira, 25 de março de 2015

Intel mais detalhes do seu futuro Xeon Phi HPC


Intel estabeleceu alguns rumores para descansar, dando uma media e analista entrevista descrevendo detalhes de sua vinda de 60 plus core chips Xeon Phi Knights Landing.


Abrindo o saco para deixar o gato ver um pouco de luz, a Intel disse aos jornalistas em uma coletiva em sua fábrica de Hillsborough, Oregon que o "buzinando grande die" para o Knights Landing Phi hospeda um nocaute oito bilhões de transistores.





Como Timothy Prickett-Morgan revela sobre a nossa irmã site The Platform , núcleo Silvermont Atom Cavaleiros do Landing terá todas as instruções de um núcleo Broadwell, exceto para a função de memória transacional TSX fechou-for-reparos.


Chipzilla ainda está segurando a sua meta de 3 teraflops para Knights Landing, e para precisão simples de ponto flutuante é agora divulgando 6 teraflops.


A empresa de ficar tímido sobre o número máximo de núcleos nos chips apoiará, além do 60 é propriedade até, mas há rumores de que haverá tantos como 72.


Haverá uma variante co-processador do dispositivo, As notas plataforma, e uma versão com 100 GB / segundo portos Omni-caminho, o primeiro chip Intel para ostentar a interface tecido hospedeiro. Com aplicações de HPC em mente, Omni-Path suporta a pilha OpenFabrics Alliance (OFA) para fornecer compatibilidade com o software escrito para ambientes Scale tecido verdadeiro InfiniBand e Intel.


Intel espera que, no entanto, que os clientes preferem do Omno-Path 100 GB / segundo, alegou menor latência e planejado de 48 portas chip chaveador mais de 36 portos do InfiniBand.


Seis canais de memória suporta até 64 GB per-stick de memória DDR4 - um total de 384 GB de memória distante para o processador - e Intel está trabalhando com a Micron para desenvolver a memória de alta largura de banda para o chip, até 16 GB por pacote .


A memória DDR4 será executado em cerca de 90 GB / segundo, com a memória local de alta largura de banda capaz de rodar nas proximidades de 400 GB / segundo.


Comunicações periféricos serão tratadas por 36 PCIe 3.0 pistas. ®



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